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B.TechECE学年 3 · 学期 2Branch core

VLSI Design

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单元 · 6

  • MOS transistor & fabrication
  • CMOS inverter & logic
  • Layout & design rules
  • Combinational & sequential design
  • Memory
  • Verilog & the ASIC flow

项目

Design and simulate a 4-bit ALU in Verilog

B.Tech

Electronics & Communication

测验与抽认卡

测试你的阅读成果，并通过间隔重复巩固记忆。

Bits AI

它可以根据你正在看的书籍、章节或测验题来回答。

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